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文本内容:
数字电子技术学校安徽新华学院院系电子通信工程专业电子信息工程学号姓名目录第一节系统概述-----------------------------------------------------------------------
31.1系统设计思路与总体方案------------------------------------------------------3第二节单元电路设计与分析--------------------------------------------------
32.1振荡器------------------------------------------------------------------------------
32.2分频器------------------------------------------------------------------------------
52.3计数器------------------------------------------------------------------------------
62.4显示器------------------------------------------------------------------------------
72.5校时电路---------------------------------------------------------------------------8第三节电路的总体设计与调试--------------------------------------------8第四节设计总结-------------------------------------------------------------------10第一节 系统概述数字电子钟是由多块数字集成电路构成的,其中有振荡器,分频器,校时电路,计数器,译码器和显示器六部分组成振荡器和分频器组成标准秒__发生器,不同进制的计数器产生计数,译码器和显示器进行显示,通过校时电路实现对时,分的校准
1.1系统设计思路与总体方案数字时钟基本原理的逻辑框图如下所示由上图可以看出,振荡器产生的__经过分频器作为产生秒脉冲,秒脉冲送入计数器,计数结果经过“时”、“分”、“秒”,译码器,显示器显示时间其中振荡器和分频器组成标准秒脉冲__发生器,由不同进制的计数器,译码器和显示电路组成计时系统秒__送入计数器进行计数,把累计的结果以“时”,“分”、“秒”的数字显示出来“时”显示由__四进制计数器,译码器,显示器构成;“分”、“秒”显示分别由六十进制的计数器,译码器,显示器构成;校时电路实现对时,分的校准第二节 单元电路设计与分析由图1的系统图知其由振荡器、分频器、计数器、译码器、 显示器、校正电路组成
2.1振荡器秒发生电路---振荡器是计时器的核心,振荡器的稳定度和频率的精确度决定了计时器的准确度一般来说,振荡器的频率越高,计时精度就越高,但耗电量将越大所以,在设计电路时要根据需要而设计出最佳电路在本设计中,采用的是精度不高的,由集成电路555与RC组成的多谐振荡器其具体电路如下图2所示;接通电源后,电容C1被充电,vC上升,当vC上升到大于2/3VCC时,触发器被复位,放电管T导通,此时v0为低电平,电容C1通过R2和T放电,使vC下降当vC下降到小于1/3VCC时,触发器被置位,v0翻转为高电平电容器C1放电结束所需的时间为 当C1放电结束时,T截止,VCC将通过R
1、R2向电容器C1充电,vC由1/3VCC上升到2/3VCC所需的时为 当vC上升到2/3VCC时,触发器又被复位发生翻转,如此周而复始,在输出端就得到一个周期性的方波,其频率为 本设计中,由电路图和f的公式可以算出,微调R3=60k左右,其输出的频率为f=1000Hz.振荡器,除了可以由上一节介绍的除外,如果对精度有较高要求的话,还可以用石英晶体构成的振荡器,这里简单介绍一下如下电路图3所示;电路振荡频率为100KHz,把石英晶体串接在由非门2,3组成的振荡反馈电路中,非门4是振荡器整形缓冲级凭借与石英晶体串联的微调电容,可以对振荡器的频率作微量的调节
2.2分频器分频器的功能主要有两个一个是产生标准秒脉冲__;二是提供功能扩展电路所需要的__,如仿电台报时用的1000Hz的高音频__和500Hz的低音频__等本设计中,由于振荡器产生的__频率太高,要得到标准的秒__,就需要对所得的__进行分频这里所采用的分频电路是由3个总规模计数器74LS90来构成的3级1/10分频其电路图如下图4所示:图4从图4可以看出,由振荡器的1000Hz高频__从U1的14端输入,经过3片74LS90的三级1/10分频,就能从U3的11端输出得到标准的秒脉冲__相应的如果输入的是100KHz时,就需要5片进行5级分频,电路图画法和上图4一样,同理依次类推
2.3计数器由图1的方框图可以清楚的看到,显示“时”、“分”、“秒”需要6片中规模计数器;其中“秒”、“分”各为60进制计数,“时”为24进制计数在本设计中均用74LS90来实现
2.
3.1六十进制计数器“秒”计数器电路与“分”计数器电路都是六十进制,它由一级十进制计数器和一级六进制计数器连接构成,如图5所示,是采用两片中规模集成电路74LS90串接起来构成的“秒”,“分”计数器图5由图5可知,U1是十进制计数器,U1的QD作为十进制的进位__,74LS90N计数器是十进制异步计数器,用反馈清零法来实现十进制计数,U2和与非门组成六进制计数74LS90N是在CP__的下降沿触发下进行计数,U2的QA和QC相与0101的下降沿,作为“分(时)”计数器的输入__U2的输出0110高电平1分别送到计数器的R
01、R02端清零,74LS90N内部的R
01、R02与非后清零而使计数器归零,完成六进制计数由此可见,U1和U2串接实现了六十进制计数__进制计数器“时”计数为24进制的,在本设计中24进制的计数电路也是由两个74LS90组成的__四进制计数电路,如图6所示图6由图6看出,当“时”个位U4计数器输入端A(14脚)来到第10触发__时,U4计数器清零,进位端QD向U3“时”十位计数器输入进位__,当第24个“时”(来自“分”计数器输出的进位__脉冲到达时U3计数器的状态位“0100”,U4计数器的状态为“0010”,此时“时”个位计数器的QC和“时”十位计数器的QB输出都为“1”,相与后为“1”把它们分别送入U3和U4计数器的清零端R01和R02,通过74LS90N内部的与非后清零,计数器复零,从而完成__四进制计数
2.4显示器用七段发光二极管来显示译码器输出的数字,显示器有两种共阴极和共阳极显示器74LS48译码器译码的是高电平,所以对应的显示器应为共阴极显示器在本设计中用的是解码七段排列显示器,即包含译码器的七段显示器其图形管脚如下图7所示图7U2是一个解码七段排列显示器,由
1、
2、
3、4脚输入二进制数,就可显示数字;而U3是个译码器,和未解码的七段显示管U1也可以构成显示器,连接如上面所示
2.5较时电路当刚接通电源或计时出现误时,都需要对时间进行校正校正电路如下图8所示图8第三章电路的总体设计与调试由第二章介绍的电路各个部分的子电路构成的各个部分的功能,再由第一章的数字时钟的系统原理框图,可以清楚的知道了总体的电路情况下面图9(下一页)就时本设计的总体电路由图9可以看出和清楚的整个数字时钟的总体工作原理和整个工作过程由555和RC构成的振荡器产生的1000Hz的高频__经过由3片74LS90构成的1/1000分频的分频器后得到标准的秒脉冲__,进入60进制的“秒”计时,“秒”的分位进入60进制的“分”计时,最后,由分的“时”进位进入24进制的“时”计时在电路中,还有由门电路和开关构成的校时电路对电路的“时”,“分”进行校时,得到正确的时间第四节设计总结通过本次设计,使我对已学过的电路、数电、模电等电子技术的知识有了更深一步的了解,锻炼和培养了自己利用已学知识来分析和解决实际问题的能力对自己以后的学习和工作有很大的帮助刚开始做这个设计的时候感觉自己什么都不知道怎么下手,脑子里比较浮躁和零乱但通过一段时间的努力,通过重温数电,模电等电子技术的书籍,还有通过查看相关的设计技术以及一些____,再加之在老师的指导和周围同学的帮助下,使我对自己的本设计有了熟练的掌握在整个的设计过程中我充满了__和用心我相信自己的实际动手能力,并一向的加强自己在这方面的努力在这次的电子技术设计中亦是如此,用自己的双手和满腔的热情来完成各个环节,不断的在图书管查看相关资料和期刊文献,特别在Internt上也收收获了很多新鲜的东西这次设计更让我熟悉了一些常用集成逻辑电路和其相应芯片的使用虽然,在本设计中所用的方案不是最好的,但我想其中的原理是最基本的;虽然其中可能出现的误差会计较大些,但是是最经济的和实用的最后,我要衷心的感谢老师给了我一次实践的机会,让我更加深刻地了解和认识到了自己的优点和不足,通过这个课程设计我发现了我好多知识都不熟悉甚至有的东西我根本就不知道,这让我感到了要学习的东西还有很多很多因此使我更坚定了在以后的学习中要扎实好基础,阔广知识面译码器译码器译码器时计数器分计数器秒计数器校时电路振荡器分频器系统方框图1图2图3。